AI系统技术栈-02-AI芯片深度解析

AI芯片深度解析：CPU/GPU/TPU/NPU架构对比与选型指南

全文摘要

本文将带你深入理解AI芯片的设计原理和架构差异，帮助你为不同的AI应用场景选择合适的硬件方案。你将学到CPU、GPU、TPU、NPU的内部架构、计算模式、性能特点，以及如何根据模型规模、延迟要求、部署环境等因素进行硬件选型。通过阅读本文，你将建立起对AI硬件的深度认知，能够理性分析不同芯片方案的优劣。

全书总结

AI芯片是深度学习计算的物理基础，不同的芯片架构对应着不同的计算哲学。本文系统梳理了CPU的通用计算架构、GPU的并行计算架构、TPU的脉动阵列架构、NPU的异构计算架构，从指令集设计讲到执行单元优化，涵盖SIMD/SIMT计算模式、内存层次结构、互联拓扑等核心话题。适合系统架构师、AI工程师、以及需要为AI项目选择硬件方案的技术决策者阅读。

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一、芯片架构与计算模式

在深入具体芯片之前，我们需要理解几个核心的计算架构概念——这些概念决定了芯片的设计哲学和适用场景。

冯诺伊曼架构与哈佛架构

这是两种经典的计算机架构设计：

flowchart LR
    subgraph VN[冯诺伊曼架构]
        CPU[CPU] --> BUS[系统总线]
        BUS --> MEM[统一内存<br>指令+数据共享]
    end

    subgraph HV[哈佛架构]
        CPU2[CPU] --> IBUS[指令总线]
        CPU2 --> DBUS[数据总线]
        IBUS --> IMEM[指令存储器]
        DBUS --> DMEM[数据存储器]
    end

    style VN fill:#e3f2fd
    style HV fill:#fff3e0

图表讲解：这张图对比了两种经典的计算机架构——理解它们是理解芯片设计的基础。

冯诺伊曼架构是最常见的架构，CPU、内存、输入输出设备都连接到同一条总线上。指令和数据存储在同一个内存中，CPU需要先取指令再取数据。这种架构的优势是设计简单、灵活，程序可以像数据一样被修改。但劣势也很明显：指令和数据共用总线，形成”冯诺伊曼瓶颈”，限制了计算速度。大多数通用CPU（如Intel/AMD处理器）都采用冯诺伊曼架构的变体。

哈佛架构则将指令存储器和数据存储器分开，CPU可以同时读取指令和访问数据。这种架构消除了指令取指和数据访问的冲突，能够实现更高的吞吐量。DSP（数字信号处理器）和一些微控制器采用哈佛架构。现代高性能处理器通常采用改进的哈佛架构，在L1缓存层面分离指令和数据，在更高层次统一。

对于AI计算来说，哈佛架构的理念更加适用——因为AI计算涉及大量的数据移动，减少内存访问冲突是优化的关键。这就是为什么很多AI芯片设计了专门的数据通路和指令通路。

SIMD与SIMT计算模式

这是并行计算的两种重要模式，对理解GPU和AI芯片至关重要：

flowchart TB
    subgraph SIMD[SIMD - 单指令多数据]
        CTRL[控制单元] --> OP[操作解码]
        OP --> ALU1[ALU 1<br>数据1]
        OP --> ALU2[ALU 2<br>数据2]
        OP --> ALU3[ALU 3<br>数据3]
        OP --> ALU4[ALU 4<br>数据4]
    end

    subgraph SIMT[SIMT - 单指令多线程]
        WARP[Warp调度器<br>32个线程] --> CORE1[核心1<br>线程1-8]
        WARP --> CORE2[核心2<br>线程9-16]
        WARP --> CORE3[核心3<br>线程17-24]
        WARP --> CORE4[核心4<br>线程25-32]
    end

    style SIMD fill:#e1f5fe
    style SIMT fill:#f3e5f5

图表讲解：这张图展示了SIMD和SIMT两种并行计算模式的差异——这是GPU编程的核心概念。

**SIMD（Single Instruction Multiple Data）**是一条指令同时对多个数据进行操作。例如，向量加法指令可以同时完成4对浮点数的相加。CPU的AVX指令集、ARM的NEON指令集都是SIMD的例子。SIMD的好处是硬件简单、控制逻辑少，能耗低。但缺点是编程相对困难，需要显式地使用向量指令，而且当数据分支较多时效率会下降（有些执行单元可能空闲）。

**SIMT（Single Instruction Multiple Threads）**是NVIDIA GPU采用的编程模式，可以看作是SIMD的演进。在SIMT中，多个线程执行相同的指令，但每个线程处理自己的数据。关键区别在于，SIMD的编程模型是显式的（你需要使用向量指令），而SIMT的编程模型是隐式的（你写的是标量代码，GPU自动将多个线程组织成warp一起执行）。SIMT还提供了更强的分支处理能力——当warp内的线程有不同分支时，GPU会串行执行各分支，但只执行相关线程，其他线程暂时休眠。

理解SIMT对于理解GPU性能至关重要。如果你在CUDA代码中写了if-else分支，而同一个warp内的线程走了不同的分支，就会发生”分支发散”，导致性能下降。这是GPU编程中常见的性能陷阱。

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二、CPU：通用计算的王者

CPU（Central Processing Unit）是最通用的处理器，几乎所有的计算设备都有CPU。虽然它不是AI计算的主力，但理解CPU是理解其他芯片的基础。

CPU的核心架构

现代CPU采用了复杂的架构设计来提高性能：

flowchart TD
    IC[指令缓存] --> ID[指令解码]
    ID[指令解码] --> ROB[重排序缓冲<br>Reorder Buffer]

    ROB --> RS1[保留站1<br>整数运算]
    ROB --> RS2[保留站2<br>浮点运算]
    ROB --> RS3[保留站3<br>内存访问]

    RS1 --> ALU[ALU]
    RS2 --> FPU[FPU]
    RS3 --> LSU[Load/Store单元]

    ALU --> RB[寄存器重命名]
    FPU --> RB
    LSU --> DC[数据缓存]

    DC --> RB
    RB --> RR[退休寄存器]

    style IC fill:#b3e5fc
    style ID fill:#81d4fa
    style ROB fill:#4fc3f7
    style ALU fill:#ffb74d
    style FPU fill:#ffb74d
    style LSU fill:#ffb74d

图表讲解：这张图展示了现代CPU的乱序执行流水线——这是CPU性能的关键秘密。

现代CPU采用了**乱序执行（Out-of-Order Execution）**技术来提高性能。基本思想是：当某条指令因为等待数据而无法执行时，CPU不会停顿，而是尝试执行后面不依赖该数据的指令。这需要复杂的硬件支持：

指令解码将机器码解码成微操作，然后送入重排序缓冲（ROB）。ROB记录指令的原始顺序和依赖关系。

**保留站（Reservation Station）**是指令的等候区，每个执行单元（整数、浮点、内存）都有自己的保留站。当指令的操作数准备好后，就会被派发到对应的执行单元。

寄存器重命名解决了数据依赖问题。如果指令A写寄存器R1，指令B也写寄存器R1，但实际上后面的指令C只需要A的结果，不需要B的。通过寄存器重命名，A和B可以写入不同的物理寄存器，避免错误依赖。

最后，**退休（Retirement）**阶段按照原始程序的顺序提交结果，确保正确的异常处理和内存序。

这套复杂的机制让CPU能够充分发掘指令级并行（ILP），在串行代码上也能获得较高性能。但代价是巨大的硬件开销和能耗——这也是为什么CPU的核心数不能像GPU那样多的原因。

CPU为什么不适合深度学习？

尽管CPU极其强大，但它在深度学习任务上表现不佳，原因有三：

（1）并行度不足：CPU通常只有几十个核心（即使是高端服务器CPU也不过128核心），而GPU有数千个计算单元。深度学习的计算（如矩阵乘法）可以分解成大量独立的简单计算，CPU的核心数远不足以充分利用这种并行性。

（2）数据带宽不足：CPU的内存带宽通常在100GB/s左右，而GPU的显存带宽可以达到2TB/s以上，是CPU的20倍。深度学习是数据密集型计算，受限于内存带宽。GPU的高带宽显存（HBM）正是为此设计。

（3）效率问题：CPU为了通用性，设计了复杂的控制逻辑（分支预测、乱序执行等），这些逻辑在深度学习计算中用处不大，却消耗了大量功耗和芯片面积。相比之下，GPU和AI芯片砍掉了这些复杂的控制逻辑，将更多的晶体管用于计算单元。

不过，这并不意味着CPU在AI系统中没有用武之地。相反，CPU在AI系统中扮演着不可替代的角色：数据预处理、模型控制逻辑、小批量推理等任务，CPU比GPU更高效。

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三、GPU：并行计算的革命

GPU（Graphics Processing Unit）最初是为了图形渲染设计，但因其强大的并行计算能力，成为深度学习的主力硬件。

GPU的架构演进

现代GPU架构经历了多代演进，以NVIDIA为例：

flowchart LR
    subgraph G80[G80时代 - 2006]
        TPC1[TPC] --> SM1[SM<br>8个SP]
    end

    subgraph FERMI[Fermi时代 - 2010]
        SM2[SM<br>32个CUDA核心] --> L2[共享L2缓存]
    end

    subgraph PASCAL[Pascal时代 - 2016]
        SM3[SM<br>128个CUDA核心] --> TC1[无Tensor Core]
    end

    subgraph TURING[Turing时代 - 2018]
        SM4[SM<br>64个CUDA核心] --> TC2[8个Tensor Core]
    end

    subgraph HOPPER[Hopper时代 - 2022]
        SM5[SM<br>128个CUDA核心] --> TC3[4个Tensor Core<br>FP8支持]
    end

    G80 --> FERMI
    FERMI --> PASCAL
    PASCAL --> TURING
    TURING --> HOPPER

    style G80 fill:#ffcdd2
    style FERMI fill:#f8bbd0
    style PASCAL fill:#f48fb1
    style TURING fill:#f06292
    style HOPPER fill:#e91e63

图表讲解：这张图展示了NVIDIA GPU架构的演进历程——反映了AI计算需求对芯片设计的深刻影响。

**G80（2006年）**是NVIDIA首款统一渲染架构的GPU，采用了TPC（Texture Processor Cluster）和SM（Streaming Multiprocessor）的层次化设计。每个SM包含8个SP（Scalar Processor），这是CUDA核心的前身。G80奠定了现代GPU架构的基础，但此时CUDA还未诞生，GPU主要用于图形渲染。

**Fermi（2010年）**是专门为计算设计的架构，引入了统一的L2缓存和更完善的内存层次。每个SM有32个CUDA核心，这个数量在后来保持了一段时间。Fermi架构确立了现代GPU的基本形态，但当时深度学习浪潮还未兴起，GPU主要用于高性能计算。

**Pascal（2016年）**代表了深度学习热潮的开始。虽然Pascal本身没有Tensor Core（那是Volta架构引入的），但它是第一款使用16nm工艺的GPU，性能功耗比大幅提升。Pascal时代的GTX 1080 Ti成为许多深度学习研究者的主力卡。

**Turing（2018年）**引入了Tensor Core，这是专门为矩阵乘法设计的计算单元。一个Tensor Core可以在一个时钟周期内完成4×4矩阵的乘累加运算，相比CUDA核心有巨大的性能提升。Turing架构标志着GPU从通用并行计算向AI专用计算的转变。

**Hopper（2022年）**是NVIDIA最新的数据中心GPU架构，引入了对FP8（8位浮点）的支持，进一步提升了AI计算的性能和能效。Hopper H100的FP8算力达到4 PFLOPS，是前代A100的6倍。

从这个演进过程可以看出，GPU的设计正在越来越专门化——从通用图形渲染到通用并行计算，再到AI专用加速。这背后反映了AI计算需求的爆发式增长。

Tensor Core的魔法

Tensor Core是NVIDIA GPU上最神秘的计算单元，它让GPU在矩阵乘法上达到了惊人的性能：

flowchart LR
    A[输入矩阵A<br>4×4 FP16] --> D[Tensor Core]
    B[输入矩阵B<br>4×4 FP16] --> D
    C[累加器C<br>4×4 FP32/FP16] --> D
    D --> E[输出矩阵<br>4×4]

    style D fill:#ff7043
    style A fill:#e1f5fe
    style B fill:#e1f5fe
    style C fill:#fff9c4
    style E fill:#c8e6c9

图表讲解：这张图展示了Tensor Core的工作原理——它是GPU加速深度学习的秘密武器。

Tensor Core是一个专门的矩阵运算单元，可以在一个时钟周期内完成D = A × B + C的运算，其中A和B是4×4的FP16矩阵，C是4×4的FP32或FP16矩阵。这相当于128次浮点乘法和96次浮点加法，总共224次浮点运算。

相比之下，传统的CUDA核心一次只能执行一次浮点乘加运算。一个Tensor Core等效于上百个CUDA核心的矩阵计算能力。

Tensor Core的设计充分利用了深度学习计算的特点：

1. 矩阵乘法是核心：卷积、全连接层都可以转换为矩阵乘法
2. 精度需求降低：训练时FP16足够，推理时甚至INT8都行
3. 计算模式固定：D = A × B + C的模式贯穿深度学习

通过降低精度（FP16 vs FP32）和专用化设计，Tensor Core在相同的芯片面积和功耗下，实现了数量级的性能提升。

不过，使用Tensor Core需要满足特定条件：

• 矩阵维度最好是4的倍数（或者更大倍数，取决于架构）
• 使用支持Tensor Core的数据类型（FP16、BF16、TF32、FP8等）
• 调用CUDA库函数或使用Tensor Core指令

现代深度学习框架（PyTorch、TensorFlow）会自动使用Tensor Core，只要你启用了混合精度训练。这是”系统优化对用户透明”的绝佳例子。

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四、TPU：谷歌的定制哲学

TPU（Tensor Processing Unit）是谷歌为加速TensorFlow计算而设计的专用芯片，代表了一种不同的设计哲学。

脉动阵列架构

TPU的核心创新是脉动阵列（Systolic Array）架构：

flowchart TB
    subgraph SA[脉动阵列 256×256]
        direction LR
        I00[•] --> I01[•] --> I02[•] --> I03[•]
        I10[•] --> I11[•] --> I12[•] --> I13[•]
        I20[•] --> I21[•] --> I22[•] --> I23[•]
        I30[•] --> I31[•] --> I32[•] --> I33[•]
    end

    W[权重<br>从右向左流动] --> SA
    I[输入<br>从上向下流动] --> SA
    SA --> O[部分和<br>累加后向下输出]

    style SA fill:#ba68c8
    style W fill:#e1bee7
    style I fill:#c5cae9
    style O fill:#c8e6c9

图表讲解：这张图展示了TPU脉动阵列的工作原理——这是定制化芯片设计的典范。

脉动阵列是一种专门用于矩阵乘法的架构。想象一个256×256的MAC（乘累加）单元阵列，权重数据从阵列的右侧向左侧流动，输入数据从上向下流动，部分和则向下累加。

在每个时钟周期：

1. 每个MAC单元从上方接收输入数据，从右侧接收权重数据
2. 执行乘法并将结果加到从上方传入的部分和上
3. 将输入数据向左传递，权重数据向下传递，更新后的部分和向下传递

这种设计的好处是：

• 数据复用：每个数据被多次使用，但只从内存读取一次
• 规则的数据流：没有复杂的寻址，控制逻辑简单
• 高效率：大部分MAC单元在每个周期都在工作，几乎没有空闲

脉动阵列的问题是灵活性较差。如果计算模式不是规则的大型矩阵乘法，脉动阵列的效率会下降。这也是为什么TPU特别适合Transformer模型，而不太适合一些不规则的计算。

TPU的代际演进

TPU也经历了多代演进：

代际	推出时间	关键特性	典型应用
TPU v1	2016	8位整数量化，只有推理能力	AlphaGo Lee
TPU v2	2017	支持训练，支持bfloat16	AlphaGo Zero
TPU v3	2018	液冷，更高性能，Pod互联	BERT训练
TPU v4	2021	光路交换，更高带宽	PaLM训练

TPU v4引入了光路交换（Optical Circuit Switching）技术，用于Pod内部的高速互联。相比传统的电交换，光交换具有更高带宽、更低延迟、更低功耗的优势，非常适合大规模分布式训练。

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五、NPU：中国的AI芯片方案

NPU（Neural Processing Unit）是中国厂商推出的AI专用芯片代表，包括华为昇腾、寒武纪MLU、燧思科技等。

昇腾架构解析

以华为昇腾910为例，其核心架构如下：

flowchart TB
    subgraph AI[昇腾910架构]
        direction TB
        host[Host CPU] --> pcie[PCIe通道]

        subgraph device[设备端]
            pcie --> aic[AICore<br>AI计算核心]
            pcie --> aicore[AICPU<br>控制核心]

            aic --> hbm[HBM显存]
            aicore --> hbm

            aic --> da[Data Engine<br>数据搬运]
            aicore --> da
        end

        hc[Host内存] -->|DMA| hbm
    end

    style aic fill:#ff7043
    style hbm fill:#42a5f5
    style aicore fill:#66bb6a

图表讲解：这张图展示了华为昇腾910的基本架构——代表了中国AI芯片的设计思路。

昇腾910采用了异构计算架构，与GPU的SIMT模型不同。它的核心计算单元是AICore，包含：

• Cube单元：用于矩阵乘法
• Vector单元：用于向量运算
• Scalar单元：用于标量运算和逻辑控制

这种分离设计让不同类型的计算能够并行执行，提高资源利用率。

昇腾使用了统一的内存空间，Host端和Device端可以通过DMA直接传输数据，简化了编程模型。同时，昇腾配套的CANN（Compute Architecture for Neural Networks）软件栈提供了完整的开发环境。

NPU的优势与挑战

NPU相比GPU的优势：

1. 本土化支持：中文文档、本地技术支持
2. 符合信创要求：满足政府、国企的国产化需求
3. 定制化优化：针对国内主流模型（如中文NLP）优化

NPU面临的挑战：

1. 生态建设：CUDA生态已经非常成熟，CANN等还在发展中
2. 性能追赶：在绝对性能上与NVIDIA最新GPU还有差距
3. 软件兼容：迁移CUDA代码到NPU需要一定工作

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六、硬件选型指南

根据不同的应用场景，硬件选型的建议如下：

按应用场景选型

flowchart TD
    Start[需求分析] --> Q1{模型规模？}

    Q1 -->|<1B参数| Small{部署环境？}
    Q1 -->|1B-100B| Medium{训练还是推理？}
    Q1 -->|>100B| Large[多GPU/TPU集群<br>或云服务]

    Small -->|边缘设备| Edge[NPU/低功耗GPU]
    Small -->|服务器| SmallGPU[单张中端GPU]

    Medium -->|训练| TrainGPU[多卡GPU<br>或TPU Pod]
    Medium -->|推理| InferGPU[专用推理卡<br>或GPU]

    style Large fill:#ef5350
    style TrainGPU fill:#42a5f5
    style InferGPU fill:#66bb6a
    style Edge fill:#ffa726

图表讲解：这张图提供了一个简单的硬件选型决策树——帮助你根据需求选择合适的硬件。

对于小模型（参数量小于10亿）：

• 如果部署在边缘设备（手机、摄像头），选择NPU或低功耗GPU
• 如果部署在服务器，单张中端GPU（如T4、A10）足够

对于中等模型（参数量10亿-1000亿）：

• 训练时需要多卡GPU（如A100集群）或TPU Pod
• 推理时可以使用专用推理卡（如T4）或使用量化的GPU

对于大模型（参数量超过1000亿）：

• 需要大规模GPU/TPU集群，或者直接使用云服务
• 自建集群的成本极高，建议评估云服务的性价比

具体产品推荐

场景	推荐产品	理由
个人学习/研究	RTX 4090 / RTX 3090	性价比高，24GB显存
小团队训练	A100 40GB / A6000	较大显存，良好生态
大规模训练	H100 / TPU v4	最高性能，NVLink/光路交换
边缘推理	Jetson / 昇腾310	低功耗，完整环境
云端推理	T4 / A10 / 昇腾310P	专用推理优化

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结语

AI芯片领域正在快速发展，新的架构和产品不断涌现。但无论技术如何变化，理解底层原理——计算架构、内存层次、互联拓扑——才能做出正确的技术选择。

GPU目前仍是主力，但TPU、NPU等专用芯片正在崛起。未来的AI系统可能不再是单一芯片，而是CPU+GPU+NPU的异构组合，每个部件做它最擅长的事。

对于工程师来说，重要的不是追逐最新的硬件，而是理解它们的设计哲学和适用场景。这样，无论技术如何变化，你都能做出正确的决策。

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常见问题解答

Q1：显存大小和计算性能哪个更重要？

答：这取决于你的具体任务。对于训练大模型，显存往往是瓶颈——如果显存不够，模型根本无法加载。此时显存大小比计算性能更重要，这也是为什么A100 80GB比H100 80GB在某些场景下更受欢迎的原因。

对于推理任务或者中小模型训练，计算性能可能更重要，能更快完成任务。一个实用的经验法则：优先保证显存够用，然后在预算范围内选择计算性能最高的。

如果显存刚好不够，再高的计算性能也无法发挥；而如果显存充足，计算性能越高，训练和推理的速度就越快。

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Q2：混合精度训练是什么？为什么能加速？

答：混合精度训练是在训练过程中同时使用不同精度的数据类型——通常用FP16（半精度浮点）存储模型参数和梯度，用FP32（单精度浮点）维护一个主副本用于精度更新。

这种方法能加速的原因有三个：（1）FP16的数据量是FP32的一半，内存访问量减半，带宽受限的场景下能获得近2倍加速；（2）FP16的计算速度更快，尤其是在Tensor Core上，可以提升数倍性能；（3）FP16占用显存更少，可以训练更大的模型或使用更大的batch size。

为了保证训练稳定性，现代框架使用loss scaling（损失缩放）技术，将loss放大防止梯度下溢。混合精度训练已经成为标准做法，几乎没有理由不使用它。

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Q3：量化是如何让模型变小的？

答：量化是将模型参数从高精度（如FP32）转换为低精度（如INT8）的过程。FP32每个参数占4字节，INT8每个参数只占1字节，量化后模型大小直接变为原来的1/4。

但这只是直接效果，更神奇的是，量化后的模型可以使用更高效的指令（如CPU的AVX-512 VNNI、GPU的Tensor Core INT8指令），计算速度也能提升2-4倍。

量化的核心挑战是如何在降低精度的同时保持模型精度。训练后量化（PTQ）直接将训练好的FP32模型转换为INT8，简单快速；感知量化训练（QAT）在训练过程中就模拟量化的影响，精度损失更小。

现代模型（尤其是大模型）通常在量化后精度损失很小，这是因为模型有冗余，精度降低反而起到了正则化的作用。

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Q4：如何评估AI芯片的性能？

答：评估AI芯片性能需要关注多个指标，不能只看TOPS（每秒万亿次运算）这个营销数字。

（1）实际性能：用你的模型和框架实测，不同芯片在不同模型上的表现差异很大；（2）显存容量和带宽：显存决定能跑多大的模型，带宽决定实际能发挥多少计算能力；（3）能效比：数据中心的电费是一笔不小的开支，高能效芯片长期使用更经济；（4）软件生态：CUDA的成熟度让NVIDIA GPU在实际使用中往往比纸面性能更强的对手表现更好；（5）互联能力：对于分布式训练，NVLink/Infinity Fabric等高速互联比单卡性能更重要；（6）总拥有成本（TCO）：包括硬件成本、电费、运维成本、开发成本。

综合评估这些因素，才能做出正确的选择。

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Q5：云服务和自建集群如何选择？

答：对于大多数公司，云服务是更好的选择。自建GPU集群需要考虑：（1）硬件采购成本高，且折旧快；（2）机房建设、电力、散热等基础设施成本；（3）运维团队的人力成本；（4）硬件故障的处理和备件。

相比之下，云服务的优势是：（1）按需付费，不用时可以关停；（2）自动升级，可以使用最新硬件；（3）无需运维，基础设施由云厂商负责；（4）弹性扩展，训练大模型时可以快速扩容。

除非你的GPU利用率很高（>70%），或者有特殊的数据安全要求，否则云服务在经济上更划算。对于初创公司和研究团队，建议先用云服务，等规模做大再考虑自建。

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更新时间：2026年3月2日 作者：AI系统技术专栏 标签：#AI芯片 GPU TPU NPU 硬件选型